大道无极‘技术BLOG

我将于茫茫人海中访我唯一灵魂的伴侣,得之,我幸;不得,我命。如此而已!!!

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基于VHDL的可变速彩灯控制器的设计

O 引言
    硬件描述语言(HDL)是相对于一般的计算机软件语言如C,Pascal而言的。HDL是用于设计硬件电子系统的计算机语言,它描述电子系统的逻辑功能、电路结构和连接方式。设计者可以利用HDL程序来描述所希望的电路系统,规定其结构特征和电路的行为方式,然后利用综合器和适配器将此程序变成能控制FPGAcpld内部结构,并实现相应逻辑功能的门级或更底层的结构网表文件和下载文件。VHDL(VeryHigh Speed IntegrATed Circuit Hardware descriptionLangtuage)主要用于描述数字系统的结构、行为、功能和接口。与其他的HDL语言相比,VHDL具有更强的行为描述能力,从而决定了它成为系统设计领域最佳的硬件描述语言。强大的行为描述能力是避开具体的器件结构。从逻辑行为上描述和设计大规模电子系统的重要保证。在文献中作者从不同的角度阐述了EDA技术的应用,它具有功能强大、描述能力强、可移植性好、研制周期短、成本低等特点,即使设计者不懂硬件的结构,也能进行独立的设计。本文以Alter公司提供的Max+PlusⅡ为平台,设计一个可变速的彩灯控制器,可以在不修改硬件电路的基础上,仅通过更改软件就能实现任意修改花型的编程控制方案,实现控制16只LED以8种花型和4种速度循环变化显示,而且设计非常方便,设计的电路保密性强。

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基于FPGA的FIR数字滤波器设计与仿真

1 引言
    实现数字化是控制系统的重要发展方向,而数字信号处理已在通信、语音、图像、自动控制、雷达、军事、航空航天等领域广泛应用。数字信号处理方法通常涉及变换、滤波、频谱分析、编码解码等处理。数字滤波是重要环节,它能满足滤波器对幅度和相位特性的严格要求,克服模拟滤波器所无法解决的电压和温度漂移以及噪声等问题。而有限冲激响应FIR滤波器在设计任意幅频特性的同时能够保证严格的线性相位特性。利用FPGA可以重复配置高精度的FIR滤波器,使用VHDL硬件描述语言改变滤波器的系数和阶数,并能实现大量的卷积运算算法。结合MATLAB工具软件的辅助设计,使得FIR滤波器具有快速、灵活、适用性强,硬件资源耗费少等特点。

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基于VHDL的4PSK调制器设计与仿真

1 引言
    目前.数字调制正逐渐取代模拟调制。许多调制都使用多进制数字调制.四进制数字相位调制是利用载波的4种不同相位来表征数字信息调制的.相位调制具有误码性能好,节省带宽。信息传输速率高等优点。采用Altera的开发工具MAX+plusII设计调制器便于仿真,它可根据仿真结果分析电路是否正确。提高电路设计的灵活性和准确性。利用VHDL硬件描述语言来描述硬件电路的功能。根据信号连接关系及定时关系的语言能有效表示硬件电路特性。

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基于VHDL的4PSK调制器设计与仿真

1 引言
    目前.数字调制正逐渐取代模拟调制。许多调制都使用多进制数字调制.四进制数字相位调制是利用载波的4种不同相位来表征数字信息调制的.相位调制具有误码性能好,节省带宽。信息传输速率高等优点。采用Altera的开发工具MAX+plusII设计调制器便于仿真,它可根据仿真结果分析电路是否正确。提高电路设计的灵活性和准确性。利用VHDL硬件描述语言来描述硬件电路的功能。根据信号连接关系及定时关系的语言能有效表示硬件电路特性。

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基于FPGA的160路数据采集系统设计

l 引言
    随着科学技术和国民经济的发展,电能需求量日益增加,对电能质量的要求也越来越高。这对电能质量的监测提出了挑战。电能质量的监测往往需要多通道数据采集,但因其覆盖面积大,周期性强,采集数据量大,因此对数据采集系统的采集、传输速度和精度提出了较高的要求。常用的数据采集方案往往采用单片机或数字信号处理器(DSP)作为控制器。以控制模数转换器(ADC)、存储器和其他外围电路的工作。但因单片机自身指令周期及处理速度的影响,很难达到多通道高速数据采集系统的要求,虽然DSP可以实现较高速的数据采集,但在提高其速度的同时,也增加了系统成本。现场可编程门阵列(FPGA)以其时钟频率高,内部延时小,速度快,效率高,组成形式灵活等特点在高速数据采集方面有着单片机和DSP无法比拟的优势。

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Niosll和USB接口的高速数据采集卡设计

引 言
    随着现代工业生产和科学研究对数据采集的要求日益提高,在瞬态信号测量、图像信号处理等一些高速、高精度的测量中,都迫切需要进行高速数据采集(如雷达信号分析、超音波信号分析);而进行数字处理的先决条件是将所研究的对象数字化,因此数据采集与处理技术日益得到重视。在图像信号处理、瞬态信号检测、工业过程检测和监控等领域,更是要求高速度、高精度、高实时性的数据采集与处理技术。现在的高速数据采集处理卡一般采用高性能数字信号处理器(DSP)和高速总线技术的框架结构。DSP用于完成计算量巨大的实时处理算法,高速总线技术则完成处理结果或者采样数据的快速传输。DSP主要采用TI和ADI公司的产品,高速总线可以采用ISA、PCI、USB等总线技术。其中PCI卡或ISA卡安装麻烦,价格昂贵,受计算机插槽数量、地址、中断资源的限制,可扩展性差,在一些电磁干扰性强的测试现场,无法专门对其做电磁屏蔽,易导致采集的数据失真。通用串行总线USB是为解决传统总线不足而推广的一种新型的通信标准。该总线接口具有安装方便、高带宽、易于扩展等优点,已逐渐成为现代数据发展趋势。基于USB的高速数据采集卡充分利用USB总线的上述优点,有效地克服了传统高速数据采集卡的缺陷。

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VHDL密码控制系统的设计和仿真

1 引言
    随着电子技术和ASIC技术的发展.数字系统设计向速度快、容量大、体积小、重量轻的趋势发展。目前数字系统设计可直接面向用户需求,根据系统的行为和功能要求,自上而下地逐层完成设计过程:描述、综合、优化、仿真与验证,以及器件生成。该设计过程除系统行为和功能描述外,其他设计几乎都由计算机自动完成,从而实现电子设计自动化(EDA)。这样大大地缩短了系统的设计周期,适应当今品种多、批量小的电子市场要求,提高了产品的竞争能力。由于电子设计自动化是采用硬件描述语言描述硬件电路,所以研究硬件语言及仿真、综合等技术是电子设计自动化的首要任务。本文提出一种利用MAX+plusⅡ开发软件环境和硬件描述语言VHDL的密码控制系统设计方案,并对系统的各个模块进行仿真分析。

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恒精度频率计的VHDL可综合代码

采用时钟频率为2MHz,不同的时钟频率需要修改相应的参数。在此只给出本时钟下的程序,其他时钟下请自行修正。

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-- Company: XJTU
-- Engineer: 唐剑峰
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-- CreATe DATe:    10:29:14 12/10/2008

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基于FPGA的嵌入式ASIP软核设计与实现

 

Design and RealizATion of FPGA - based Embedded ASIP IP Core
 
摘要:采用ASIP+FPGA模式设计了一款嵌入式微处理器软核,以该软核为例从体系结构和指令集设计两方面对ASIP+FPGA模式微处理器软核的设计进行了分析和验证,最后通过与传统微处理器对比验证了该设计模式的优势:指令针对性强,执行效率高;易于扩展,适应性强。
关键词:嵌入式系统;处理器软核;ASIP;FPGA;VHDL
 
Abstract :This paper designs a kind of soft-core Processor in ASIP+FPGA mode and takes it as a example to analyze and validATe the ASIP+FPGA mode from two aspects include architectonic design and instruction set design. AT last, we conclude thAT the ASIP+FPGA mode has two advantages contrast normal micro-processor by test dATa, they are high implement efficiency and easy to extend.
Key words:Embedded System; Soft-Core Processor; ASIP; FPGA; VHDL

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计算机EPP控制CPLD显示点阵汉字的实现

 

摘要本文主要讨论了使用计算机增强型并口EPP协议控制cpld,向其发送汉字点阵数据并在16*16 LED点阵上显示的实现。实际测试并证明了EPP模式下计算机并口与cpld及VHDL结合进行电子设计的可行性与高效性,这种设计方式在高校电子教学中有很好的指导作用,可以有效地提高学生的动手能力和团队意识。
关键词:EDA;EPP;cpld;VHDL;汉字点阵
 
ImplementATion of Chinese Character LED Display Based On EPP and cpld
 
Abstract: The paper introduces the implementATion of controlling cpld via PC EPP port, and sends Chinese characters to display on 16*16 LED. The design practiced and proved the feasibility and high-efficiency of the electrical design by the combinATion of PC EPP port, cpld and VHDL. Such design mode can be used in college electronics educATion in order to enhance students’ skill and team work spirit.
Keywords: EDA; EPP; cpld; VHDL; Chinese character LED

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8x8DCT变换的VHDL代码

8x8DCT变换的VHDL代码

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基于VHDL写的DS18B20的驱动

基于VHDL写的DS18B20的驱动

library ieee;
use ieee.std_logic_1164.all;
use ieee.std_logic_unsigned.all;

entity ds18b20 is
port(start: in std_logic;
ioout: out std_logic;
ioin: in std_logic;

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基于VHDL的交通灯控制器设计

应用VHDL语言设计数字系统,大部分设计工作可在计算机上完成,从而缩短系统开发时间,提高工作效率。下面介绍基于VHDL设计交通灯控制器的一种方案,并给出源程序和仿真结果。

1 系统功能与要求

交通灯控制器控制两个主干道交叉路口的交通,路口车辆多,直行信号、左转弯信号分开显示,a,b两个主干道的通行时间相等,其中指示直行的绿灯亮30 s,指示左转弯的绿灯亮12 s,绿灯变至红灯时,黄灯亮3 s,以便于车辆能停在停车线内,红灯信号的最后3 s相应的黄灯也同时亮,以便提示驾驶人员准备起步。在两个主干道路口都配备传感器用来检测有无车辆通行。当两个主干道都有车辆时,自动处于主干道a绿灯,主干道b红灯的状态,然后轮流切换通行。当主干道a无车辆时,自动处于主干道b绿灯,主干道a红灯的状态;反之亦然,以提高通行效率。

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VHDL程序与仿真二十四---步进电机定位控制系统

 

library IEEE;
use IEEE.std_logic_1164.all;
use IEEE.std_logic_arith.all;
use IEEE.std_logic_unsigned.all;
 
entity step_motor is
port (reset:in STD_LOGIC; --系统复位信号

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VHDL程序与仿真二十三---多功能波形发生器

 

--文件名:mine4.vhd
--功能:实现4种常见波形正弦、三角、锯齿、方波(AB)的频率、幅度可控输出(方波

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